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文檔簡介
1、隨著LPDDR(Low Power Double Data Rate)高速并行總線技術(shù)的快速發(fā)展,其工作頻率不斷上升,供電電壓不斷降低,使信號(hào)完整性問題成為產(chǎn)品設(shè)計(jì)中首要解決的問題。相比LPDDR3技術(shù)而言,LPDDR4技術(shù)使用更高的工作速率,更低的供電電壓,其對(duì)信號(hào)完整性的影響更大。
本論文以最新的LPDDR4高速并行總線為背景,通過仿真的方法對(duì)高速電路設(shè)計(jì)中的信號(hào)完整性問題進(jìn)行了研究。首先,從高速電路設(shè)計(jì)基礎(chǔ)理論入手,介紹
2、了傳輸線理論、信號(hào)完整性理論、電源完整性理論、信號(hào)仿真分析原理,從而為后面LPDDR4布局布線前因素仿真分析和布局布線后仿真驗(yàn)證分析奠定理論基礎(chǔ)。然后,以此為理論指導(dǎo),對(duì)傳輸線進(jìn)行建模,求解得到RLGC模型文件,并以此模型文件為主,以spice仿真程序的形式搭建電路仿真模型,從DMI線、線長、線間距、信號(hào)頻率、端接阻抗匹配以及終端負(fù)載大小等方面對(duì)LPDDR4高速并行總線展開布局布線前的因素仿真分析,為后面的LPDDR4實(shí)際布局布線提供一
3、般性指導(dǎo)建議。
最后通過實(shí)例,利用信號(hào)電源協(xié)同仿真技術(shù)對(duì) LPDDR4布局布線進(jìn)行驗(yàn)證仿真分析,包括信號(hào)模型及電源配送網(wǎng)絡(luò)模型S參數(shù)的提取,spice語言形式的信號(hào)電源協(xié)同仿真電路模型的建立,以及最后的仿真結(jié)果分析。并從改善電源配送網(wǎng)絡(luò)和在信號(hào)線周圍增加地保護(hù)線的角度對(duì)LPDDR4布局布線進(jìn)行優(yōu)化設(shè)計(jì)與仿真分析。另外,本論文通過與普通的信號(hào)仿真方法對(duì)比,體現(xiàn)出信號(hào)電源協(xié)同仿真技術(shù)的優(yōu)勢(shì)。利用此技術(shù)可以更加精確地模擬出產(chǎn)品在實(shí)際
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