網絡處理器中SDRAM存儲器接口模塊設計研究.pdf_第1頁
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文檔簡介

1、當前計算機網絡的用戶數目與連接帶寬的迅速增長，導致了對網絡處理器性能不斷增長的需求，“存儲器墻”的問題已經成為處理器性能提高的關鍵。網絡處理器外接SDRAM用于存儲較大的網絡數據包以及指令代碼，SDRAM控制器主要用于控制內部多處理器對外接SDRAM進行訪問，將處理器命令翻譯成SDRAM操作命令，時序要求復雜。
　　 不同于常規(guī)的單核SDRAM控制器，本文設計的SDRAM控制器主要是面向網絡處理中異構并行多處理器對外接SDRAM

2、的資源共享，單一的仲裁算法已經很難滿足系統(tǒng)性能要求，為實現異構多核處理器對SDRAM公平有效及時的訪問，本文采用了分層優(yōu)先仲裁機制，總體層面上采用了固定優(yōu)先級和時分復用法相結合的分層仲裁算法，另外為提高SDRAM訪問效率，又加入動態(tài)仲裁算法機制，提供奇數和偶數兩個命令隊列，實現SDRAM預充電時間的隱藏。
　　 另外針對以太網幀長以及多核處理器系統(tǒng)中不可忽視的總線延遲和多核指令排隊延遲的特點設計了基于指令控制的塊數據傳輸機制，通

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