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文檔簡介
1、RS(Reed-Solomon)碼是差錯控制領(lǐng)域中一類重要的線性分組碼，由于其出眾的糾錯能力，因而被廣泛地應用于各種差錯控制系統(tǒng)中，以滿足對數(shù)據(jù)傳輸通道可靠性的要求。 本文重點研究RS碼的編譯碼方法以及基于FPGA(FieldProgrammableGateArray)的RS碼實現(xiàn)方法。對所設(shè)計的硬件系統(tǒng)的主要性能指標進行了仿真及實際功能測試，并給出了功能仿真波形圖和實際測試的結(jié)果。 國內(nèi)RS編碼譯碼用FPGA來實現(xiàn)還沒
2、有較成熟的產(chǎn)品，用定制的RS編碼芯片或可編程的數(shù)字信號處理(DSP)芯片的實現(xiàn)方案都有各自的局限，無法普遍嵌入設(shè)計系統(tǒng)中。這就需要我們研究出比較通用的實現(xiàn)方法。 本文的主要工作和創(chuàng)新：1)采用現(xiàn)場可編程門陣列(FPGA)實現(xiàn)了RS碼的編碼和譯碼。2)對大運算量環(huán)節(jié)進行改進，不僅減少了邏輯單元的占用量，而且速度上也得到提高，這是本論文創(chuàng)新之一。3)軟件上用VHDL語言實現(xiàn)RS編碼譯碼，包括伽羅瓦(Galoias)域內(nèi)的乘法器設(shè)計，
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