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1、河北工業(yè)大學(xué)碩士學(xué)位論文異步FIFO存儲器的設(shè)計姓名:趙士達申請學(xué)位級別:碩士專業(yè):物理電子學(xué)指導(dǎo)教師:趙紅東20081001異步FIFO存儲器的設(shè)計IITheDesignofAsynchronousFIFOMemyAbstractFIFOisamethodoffirstinfirstout.AsynchronousFIFOisageneralwaytocommunicatebetweendifferentclockdomains.Th
2、isthesismakesananalysisresearchfasynchronousFIFOmemyproposedsolutions.InthisthesisgraycodeisusedtoinsteadofbinarycodeonlyonebitmaybegometastableThusreducingtheprobabilityofemergenceofmetastable.Addinganextrabittoeachpoin
3、terisproposedtodistinguishbetweenfullempty.InthisthesisASICflowisappliedtothedesignofasynchronousFIFOmemy.VerilogHDLisusedtocodeRTLlevelcodebuildtestbenchsimulationvect.UsingCadencesNCverilogNovas’Verdisimulatedebugthede
4、signafterseveralroundsofdebuggingallfeaturesmeetthedesignrequirement.Synopsys’DesignCompilerisusedflogicsynthesiswhosegoalsarereadclock83MHzwriteclock125MHz.Afterlogicsynthesisscanchainsynthesistestpatternsarecompletedby
5、DFTCompilerTetraMax.LastlyfmalverificationstatictiminganalysisareverifiedbyrelatedtoolsofSynopsys.InthisthesistheasynchronousFIFOmemycanbeusedinSoC(SystemonChip)asIP(IntellectualProperty).KEYWDS:asynchronousFIFOmulticloc
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