USB接口拉信號完整性設(shè)計與分析.pdf_第1頁
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文檔簡介

1、在高速數(shù)字系統(tǒng)設(shè)計中，信號完整性問題是工程師必須考慮的。由于芯片時鐘頻率的提高，信號的上升沿變化越來越快，信號完整性是芯片發(fā)展的直接產(chǎn)物。隨著處理器運算能力的提升，總線數(shù)據(jù)傳輸速率成為了瓶頸，如何更快地增加總線數(shù)據(jù)傳輸率成為工程師熱點研究問題之一。
　　本論文是以通用串行總線USB2.0為對象，研究信號完整性問題。首先闡述了高速互連中產(chǎn)生信號完整性問題的傳輸線理論，著重研究了影響USB2.0布局布線的差分傳輸線。通過采用Cypre

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