MOS模擬集成電路交互式自動(dòng)化Sizing符號(hào)化方法探索研究和軟件實(shí)現(xiàn).pdf_第1頁(yè)
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1、在如今的集成電路設(shè)計(jì)流程中,所占面積很小的模擬集成電路往往需要很長(zhǎng)的設(shè)計(jì)時(shí)間,自動(dòng)化程度較低。本文嘗試在新型的符號(hào)化電路仿真器的基礎(chǔ)上,研究實(shí)現(xiàn)了通過(guò)符號(hào)化靈敏度計(jì)算來(lái)優(yōu)化運(yùn)算放大器電路Sizing的方法,并完成了一個(gè)簡(jiǎn)單的運(yùn)算放大器設(shè)計(jì)軟件。
　　本文將主要介紹利用符號(hào)化仿真引擎和EKV器件模型,進(jìn)行靈敏度分析的算法,并在得到的電路靈敏度分析的結(jié)果的基礎(chǔ)上,嘗試了使用靈敏度信息來(lái)對(duì)電路進(jìn)行互動(dòng)設(shè)計(jì)方法以及自動(dòng)優(yōu)化電路的算法(自適

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